RISC-V

RISC-V steht für „Reduced Instruction Set Computer V“, eine offene Befehlssatzarchitektur (Instruction Set Architecture, ISA) für Prozessoren. Das 2011 von der University of California in Berkley und Industriepartnern vorgestellte Projekt basiert auf einer Serie akademischer Forschungsprogramme, die sich mit dem Erstellen paralleler Soft- und Hardware beschäftigten. RISC-V ist sehr flexibel ausgelegt und lässt sich an viele Applikationen anpassen. Die Stiftung RISC-V Foundation betreut das Projekt aktiv.

Anders als viele Befehlssatzarchitekturen ist RISC-V unter einer BSD-Open-Source-Lizenz (Berkeley Software Distribution) verfügbar. Daher kann jeder Prozessoren oder Cores auf Basis dieser Architektur entwickeln, herstellen (lassen) und verkaufen, ohne Lizenzgebühren zahlen zu müssen. Somit ist RISC-V eine quelloffene Alternative zu proprietären Prozessor-Designs. Mittlerweile wird RISC-V auf breiter Front von Akteuren aus der Industrie und Forschung unterstützt.
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RISC-V Fachwissen:

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Neue Open-Source-CPU-Technologien ermöglichen den Aufbau datenzentrischer Architekturen mit kohärentem, geteiltem Arbeitsspeicher und intelligenten Busschnittstellen. lesen

RISC-V-Befehlssatz für den Industriemarkt

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RISC-V und sein Potential für den Industriemarkt

Befehlssatzarchitektur

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