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Xcelium parallel Simulator Produktions-bewährter paralleler Simulator

| Redakteur: Sebastian Gerstl

Cadence hat mit dem Xcelium Parallel Simulator den ersten Produktions-bewährten Simulator der dritten Generation vorgestellt. Er basiert auf einer innovativen parallelen Multi-Core-Rechentechnologie, mit der SoCs (System on Chip) schneller auf den Markt gebracht werden können. Im Mittel können Kunden eine doppelt so hohe Single-Core-Leistung und eine mehr als fünffach höhere Multi-Core-Leistung gegenüber Simulatoren der vorherigen Generation erreichen.

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Der parallele Simulator XCelium von Cadence baut auf der bewährten Incisive Engine auf und ergänzt diese um die revolitionäre neue IP von Rocketick. Das Ergebnis ist eine Optimierte Simulationsplattform, die eine Verdoppelung der Entwicklungszeiten bei Single-Core designs und eine bis zu zehnmal effizientere Simulation von Multi-Core-Designs ermöglicht.
Der parallele Simulator XCelium von Cadence baut auf der bewährten Incisive Engine auf und ergänzt diese um die revolitionäre neue IP von Rocketick. Das Ergebnis ist eine Optimierte Simulationsplattform, die eine Verdoppelung der Entwicklungszeiten bei Single-Core designs und eine bis zu zehnmal effizientere Simulation von Multi-Core-Designs ermöglicht.
(Bild: Cadence)

Der Xcelium Simulator basiert auf der parallelen Simulationstechnologie, die von Rocketick übernommen wurde. Zusätzlich setzt sie auf Cadences bewährter Incisive Enterprise Simulation Engine auf. Als einziger Simulator verkürzt der Xcelium Simulator die Laufzeit, und zwar im Mittel durch eine dreifach schnellere Design-Simulation auf RTL-Ebene (Register Transfer Level), eine fünffach schnellere Simulation auf Gate-Ebene und eine zehnfach schnellere parallele DFT-Simulation (Design for Test). Dadurch lässt sich die Projektlaufzeit um mehrere Wochen verkürzen.

Der Xcelium Simulator verspricht eine breite Anwendbarkeit: Er unterstützt moderne Design-Stile und IEEE-Standards und ermöglicht so den Ingenieuren eine Leistungssteigerung ohne eine erneute Code-Erstellung. Der Kompilations- und Entwicklungs-Flow des Simulators passt den Design- und Verifikations-Testbench-Code den idealen Engines an und wählt automatisch die optimale Anzahl von Cores für eine beschleunigte Ausführung aus.

Neue Funktionen beschleunigen zudem die SoC-Verifikation samt der SoC SystemVerilog Testbench Abdeckung für ein schnelleres Abschließen der Verifikation und ein paralleles Multi-Core-Build.

Der Xcelium Simulator ist eine weitere Innovation innerhalb der Cadence Verification Suite und unterstützt die System Design Enablement (SDE) Strategie des Unternehmens, mit der System- und Halbleiter-Unternehmen komplette, differenzierte Endprodukte effizienter entwickeln können. Die Verifikations-Suite besteht aus erstklassigen Core-Engines, Verification-Fabric-Technologien und Lösungen, welche die Design-Qualität und den Durchsatz erhöhen sowie die Verifikationsforderungen für unterschiedlichste Anwendungen und vertikale Segmente erfüllen.

Mehr Informationen finden Sie auf der Webseite des Anbieters: www.cadence.com.

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